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TMS320VC5510AGGWA2 Bestand und Preise

TI DSP Fixed-Point 32Bit 200MHz 400MIPS 240Pin BGA MICROSTAR
46.99
TMS320VC5510AGGWA2
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TMS320VC5510AGGWA2 TI
TI
  • Hersteller:
    TI
  • Hersteller-Nr:
    TMS320VC5510AGGWA2
  • AiPCBA-Teilenummer:
    CM12541678
  • Preis (EUR):
    46.99
  • AiPCBA-Lager:
    202 Stk
  • Verfügbarkeit:
    161 Stück auf Lager
    Lagerbestand des Lieferanten, muss mit dem Verkauf bestätigt werden
  • Produktkategorie:
    Digitale Signalprozessoren (DSPs)
  • Produktbeschreibung:
    DSP Fixed-Point 32Bit 200MHz 400MIPS 240Pin BGA MICROSTAR
  • Dokumentation: 3D-Modell
TMS320VC5510AGGWA2 Kaufen TMS320VC5510AGGWA2 Bestand & Preis aktualisiert um 2024-07-04 03:50:22
  • Aktualisieren
    Teilenummer: TMS320VC5510AGGWA2
    AiPCBA P/N: CM12541678
    Hersteller: TI
    Preis
    46.99
    Gesamt: 363 Stk
    MOQ: 1
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    TMS320VC5510AGGWA2 Spezifikationen Ähnliche Produkte anzeigen (99+)
    TYP
    BESCHREIBUNG
    AUSWÄHLEN
    Hersteller
    TI
    Kategorie
    Digitale Signalprozessoren (DSPs)
    3D-Modell
     3D-Modell
    Montagesmethoden
    Surface Mount
    Anzahl von Pins
    240 Pin
    Verpackung
    BGA-240
    Frequenz
    200 MHz
    Taktfrequenz
    200 MHz
    RAM-Größe
    320 KB
    Betriebstemperatur (max.)
    85 ℃
    Betriebstemperatur (Min)
    -40 ℃
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    TMS320VC5510AGGWA2 Datenblatt-PDF
    TMS320VC5510AGGWA2 Datenblatt PDF
    90 Pages, 1407 KB
    2012/03/28
    Ansicht
    TMS320VC5510AGGWA2 Benutzerreferenzhandbuch
    90 Pages, 1269 KB
    2017/04/17
    Ansicht
    Größe & Paket
    TYP
    BESCHREIBUNG
    Betriebstemperatur
    -40℃ ~ 85℃
    Produktlebenszyklus
    Active
    Verpackungsmethoden
    Tray
    Umwelt
    TYP
    BESCHREIBUNG
    RoHS-Standard
    Non-Compliant
    Bleifreier Status
    Contains Lead
    Exportklassifikationen
    TYP
    BESCHREIBUNG
    ECCN Code
    3A991.a.2
    Funktionsübersicht
    • The TMS320VC5510/5510A (5510/5510A) fixed-point digital signal processors (DSPs) are based on the TMS320C55x DSP generation CPU processor core. The C55x™;DSP architecture achieves high performance and low power through increased parallelism and total focus on reduction in power dissipation. The CPU supports an internal bus structure composed of one program bus, three data read buses, two data write buses, and additional buses dedicated to peripheral and DMA activity. These buses provide the ability to perform up to three data reads and two data writes in a single cycle. In parallel, the DMA controller can perform up to two data transfers per cycle independent of the CPU activity.
    • The C55x CPU provides two multiply-accumulate (MAC) units, each capable of 17-bit x 17-bit multiplication in a single cycle. A central 40-bit arithmetic/logic unit (ALU) is supported by an additional 16-bit ALU. Use of the ALUs is under instruction set control, providing the ability to optimize parallel activity and power consumption. These resources are managed in the address unit (AU) and data unit (DU) of the C55x CPU.
    • The C55x™; DSP generation supports a variable byte width instruction set for improved code density. The instruction unit (IU) performs 32-bit program fetches from internal or external memory and queues instructions for the program unit (PU). The program unit decodes the instructions, directs tasks to AU and DU resources, and manages the fully protected pipeline. Predictive branching capability avoids pipeline flushes on execution of conditional instructions. The 5510/5510A also includes a 24K-byte instruction cache to minimize external memory accesses, improving data throughput and conserving system power.
    • The 5510/5510A peripheral set includes an external memory interface (EMIF) that provides glueless access to asynchronous memories like EPROM and SRAM, as well as to high-speed, high-density memories such as synchronous DRAM and synchronous burst SRAM. Three full-duplex multichannel buffered serial ports (McBSPs) provide glueless interface to a variety of industry-standard serial devices, and multichannel communication with up to 128 separately enabled channels. The enhanced host-port interface (EHPI) is a 16-bit parallel interface used to provide host processor access to internal memory on the 5510/5510A. The EHPI can be configured in either multiplexed or non-multiplexed mode to provide glueless interface to a wider variety of host processors. The DMA controller provides data movement for six independent channel contexts without CPU intervention, providing DMA throughput of up to two 16-bit words per cycle. Two general-purpose timers, eight general-purpose I/O (GPIO) pins, and digital phase-locked loop (DPLL) clock generation are also included.
    • The 5510/5510A is supported by the industry’s leading eXpressDSP™; software environment including the Code Composer Studio™; integrated development environment, DSP/BIOS™; software kernel foundation, the TMS320™; DSP Algorithm Standard, and the industry’s largest third-party network. Code Composer Studio features code generation tools including a C-Compiler, Visual Linker, simulator, Real-Time Data Exchange (RTDX™;), XDS510™; emulation device drivers, and Chip Support Libraries (CSL). DSP/BIOS is a scalable real-time software foundation available for no cost to users of Texas Instruments’ DSP products providing a pre-emptive task scheduler and real-time analysis capabilities with very low memory and megahertz overhead. The TMS320 DSP Algorithm Standard is a specification of coding conventions allowing fast integration of algorithms from different teams, sites, or third parties into the application framework. Texas Instruments’ extensive DSP third-party network of over 400 providers brings focused competencies and complete solutions to customers.
    • Texas Instruments (TI) has also developed foundation software available for the 5510/5510A. The C55x DSP Library (DSPLIB) features over 50 C-callable software kernels (FIR/IIR filters, Fast Fourier Transforms (FFTs), and various computational functions). The DSP Image/Video Processing Library (IMGLIB) contains over 20 software kernels highly optimized for C55x DSPs and is compiled with the latest revision of the C55x DSP code generation tools. These imaging functions support a wide range of applications that include compression, video processing, machine vision, and medical imaging.
    • The TMS320C55x DSP core was created with an open architecture that allows the addition of application-specific hardware to boost performance on specific algorithms. The hardware extensions on the 5510/5510A strike the perfect balance of fixed function performance with programmable flexibility, while achieving low-power consumption, and cost that traditionally has been difficult to find in the video-processor market. The extensions allow the 5510/5510A to deliver exceptional video codec performance with more than half its bandwidth available for performing additional functions such as color space conversion, user-interface operations, security, TCP/IP, voice recognition, and text-to-speech conversion. As a result, a single 5510/5510A DSP can power most portable digital video applications with processing headroom to spare. For more information, see the _TMS320C55x Hardware Extensions for Image/Video Applications Programmer’s Reference _(literature number SPRU098). For more information on using the the DSP Image Processing Library, see the _TMS320C55x Image/Video Processing Library Programmer’s Reference _(literature number SPRU037).

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    • - Sorgfältig geprüft und verpackt von AiPCBA
      - Vakuumverpackung
      - Antistatische Verpackung
      - Antivibrationsschaum
    • - Einkommensqualitätskontrolle (IQC), über 800 qualifizierte Vertriebspartner.
      - 500 m² Labor für fortschrittliche Komponententests, Fälschungserkennung, RoHS-konform usw.
      - 2000 m² digitales Komponentenlager, konstante Temperatur und Luftfeuchtigkeit
      - Entkapselungsinspektion
      - Röntgeninspektion
      - XRF-Inspektion
      - Elektrische Prüfung
      - Oberflächenprüfung
    • - Substandard- und Fälschungserkennung
      - Fehleranalyse
      - Elektrische Prüfung
      - Lebenszyklus- und Zuverlässigkeitstests
      - AiPCBA hat 2021 ein Komponententestlabor eingerichtet
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